Contributions de l’utilisateur
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- 14 novembre 2018 à 15:59 (diff | hist) . . (+4 392) . . N IRL - Vulnerability search in Industrial Control Systems: a reverse engineering approach (Page créée avec « Titre : Vulnerability search in Industrial Control Systems: a reverse engineering approach Sujet proposé dans : M2 MOSIG, Projet --- M2R Informatique, Projet --- Magister... ») (actuel)
- 14 novembre 2018 à 15:59 (diff | hist) . . (+96) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 12 octobre 2018 à 14:51 (diff | hist) . . (+1 821) . . N IRL - Code robustness against fault injection (Page créée avec « laboratoire: Verimag contact : Claire Maiza (claire.maiza@univ-grenoble-alpes.fr) remarque : si le contexte de l'analyse de programme pour la sécurité vous intéres... ») (actuel)
- 12 octobre 2018 à 14:45 (diff | hist) . . (+88) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 12 octobre 2018 à 14:42 (diff | hist) . . (+1 036) . . N IRL - Combination of cache analyses (Page créée avec « - Titre: Combinations of cache analyses - responsable(s) Claire Maiza, David Monniaux (prenom.nom@univ-grenoble-alpes.fr) - laboratoire : Verimag - mots-clés : Cache m... ») (actuel)
- 12 octobre 2018 à 14:40 (diff | hist) . . (-1) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 12 octobre 2018 à 14:40 (diff | hist) . . (+95) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 12 octobre 2018 à 14:37 (diff | hist) . . (+47) . . IRL - Scalability of the interference analysis for a multi-core platform (actuel)
- 12 octobre 2018 à 14:36 (diff | hist) . . (+3) . . IRL - Scalability of the interference analysis for a multi-core platform
- 12 octobre 2018 à 14:35 (diff | hist) . . (+1 352) . . N IRL - Scalability of the interference analysis for a multi-core platform (Page créée avec « encadrement : Claire Maiza (Verimag), Matthieu Moy (LIP, Lyon) sujet : In automotive and avionics, some programs are subject to critical timing constraints. In these real-... »)
- 12 octobre 2018 à 14:32 (diff | hist) . . (+172) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 13 octobre 2017 à 07:07 (diff | hist) . . (+2 387) . . N Control-Flow Integrity and Attacker Models (Page créée avec « * Responsables : Laurent Mounier (Laurent.Mounier@imag.fr) VERIMAG-DCS Marie-Laure Potet (Marie-Laure.Potet@imag.fr) VERIMAG * Mots-clés : software security, co... ») (actuel)
- 13 octobre 2017 à 07:04 (diff | hist) . . (+50) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 12 octobre 2017 à 12:07 (diff | hist) . . (+1 907) . . N Combining Path and Cache Analyses (Page créée avec « * Where? Verimag lab, IMAG building * Who? Claire Maiza, Catherine Vigouroux, Valentin Touzeau (contact: prenom.nom@univ-grenoble-alpes.fr) * What? CPUs are usually muc... ») (actuel)
- 12 octobre 2017 à 12:05 (diff | hist) . . (+40) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 12 octobre 2017 à 12:03 (diff | hist) . . (+1 770) . . N Cache Analysis for Security (Page créée avec « * Where? Verimag lab, IMAG building * Who? Claire Maiza, Laurent Mounier and Valentin Touzeau (contact: prenom.nom@univ-grenoble-alpes.fr) * What? CPUs are usually much... ») (actuel)
- 12 octobre 2017 à 12:01 (diff | hist) . . (+34) . . Introduction A La Recherche En Laboratoire 2A (→Sujets proposés dans les laboratoires (à remplir par les encadrants))
- 12 octobre 2017 à 12:00 (diff | hist) . . (+2 340) . . N Accurately predicting software cache attacks (Page créée avec « Supervisors: Cristian Ene, Claire Maiza, Valentin Touzeau (contact: prenom.nom@univ-grenoble-alpes.fr) Cache attacks are a specific kind of side-channel attacks where an... ») (actuel)
- 12 octobre 2017 à 11:56 (diff | hist) . . (+51) . . Introduction A La Recherche En Laboratoire 2A (→Sujets plutôt "info" (ceux précédés d'une * sont déjà pris))
- 1 février 2016 à 13:18 (diff | hist) . . (-2 819) . . 3MMCEP (→Sujets et documents)
- 29 janvier 2016 à 13:23 (diff | hist) . . (-884) . . 3MMCEP (→Documents complémentaires)
- 29 janvier 2016 à 13:23 (diff | hist) . . (-3 309) . . 3MMCEP (→Partie Exploitation des Processeurs)
- 29 janvier 2016 à 13:23 (diff | hist) . . (-1 653) . . 3MMCEP (→Format du rendu pour le projet de Conception de Processeur)
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- 10 avril 2015 à 16:13 (diff | hist) . . (-86) . . 3MMCEP (→Déroulement)
- 8 avril 2015 à 13:37 (diff | hist) . . (-36) . . 3MMCEP (→Déroulement)
- 4 février 2015 à 13:35 (diff | hist) . . (-8) . . 3MMCEP (→Mise en route)
- 4 février 2015 à 13:31 (diff | hist) . . (0) . . Fichier:CEP cdc.pdf (a téléversé une nouvelle version de « Fichier:CEP cdc.pdf »)
- 3 février 2015 à 14:25 (diff | hist) . . (-1 343) . . 3MMCEP (→Sujet du projet)
- 15 décembre 2014 à 16:04 (diff | hist) . . (-5) . . La filière SLE (→Conférences technologiques - Planning 2014-2015)
- 8 décembre 2014 à 15:39 (diff | hist) . . (+71) . . La filière SLE (→Conférences technologiques - Planning 2014-2015)
- 15 avril 2014 à 11:39 (diff | hist) . . (-2) . . 3MMCEP (→Partie Exploitation des Processeurs)
- 15 avril 2014 à 11:38 (diff | hist) . . (0) . . N Fichier:Fct abr.s.c (actuel)
- 15 avril 2014 à 11:34 (diff | hist) . . (+36) . . 3MMCEP (→Partie Exploitation des Processeurs)
- 4 février 2014 à 10:39 (diff | hist) . . (0) . . Fichier:CEP cdc.pdf (a téléversé une nouvelle version de « Fichier:CEP cdc.pdf »)
- 30 janvier 2014 à 11:17 (diff | hist) . . (+2) . . 3MMCEP (→Format du rendu)
- 30 janvier 2014 à 11:14 (diff | hist) . . (+10) . . 3MMCEP (→Introduction)
- 4 octobre 2013 à 12:44 (diff | hist) . . (+46) . . Travaux Pratiques d'Architecture 1 (→TP 6 : Analyse du fonctionnement d'un processeur MIPS sur FPGA)
- 4 octobre 2013 à 12:43 (diff | hist) . . (+1) . . Travaux Pratiques d'Architecture 1 (→TP 5 : Conception d'une architecture PC/PO : circuit PGCD sur FPGA)
- 4 octobre 2013 à 12:41 (diff | hist) . . (-14) . . Travaux Pratiques d'Architecture 1 (→TP 4 : Réalisation d'un circuit de contrôle d'écran VGA sur FPGA)
- 4 octobre 2013 à 12:39 (diff | hist) . . (+1) . . Travaux Pratiques d'Architecture 1 (→TP 4 : Réalisation d'un circuit de contrôle d'écran VGA sur FPGA)
- 4 octobre 2013 à 12:39 (diff | hist) . . (+1) . . Travaux Pratiques d'Architecture 1 (→TP 4 : Réalisation d'un circuit de contrôle d'écran VGA sur FPGA)
- 4 octobre 2013 à 12:37 (diff | hist) . . (-9) . . Travaux Pratiques d'Architecture 1 (→TP 3 : Conception de circuits simples avec des outils de CAO pour FPGA)
- 4 octobre 2013 à 12:37 (diff | hist) . . (0) . . Travaux Pratiques d'Architecture 1 (→TP 3 : Conception de circuits simples avec des outils de CAO pour FPGA)
- 4 octobre 2013 à 12:36 (diff | hist) . . (0) . . Travaux Pratiques d'Architecture 1 (→TP 2 : Assemblage manuel de portes élémentaires sur PlaqueLab)
- 4 octobre 2013 à 12:35 (diff | hist) . . (0) . . N Fichier:Archi1 tp3 2013.pdf (actuel)
- 4 octobre 2013 à 12:35 (diff | hist) . . (0) . . N Fichier:Archi1 tp4 2013.pdf
- 4 octobre 2013 à 12:35 (diff | hist) . . (0) . . N Fichier:Archi1 tp5 2013.pdf
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